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关于PCB设计中的EMC常见问题总结

作者:365滚球 发布时间:2020-12-05 09:21 点击数:

  叠层结构:严格控制特性阻抗在规范范围内,保证走线到参考层的距离小于到其他层的距离,这是板级

  高速电路和低速电路,数字电路模拟电路,IO电路,尽量都有自己的区域,避免重叠。

  布线的一个指导原则,电流必须构成一个完整回路的,所以我们必须要人为给其设置一个路径,让它按照我们想要的路径来走,并且,让这个回路的面积尽量小。

  高频信号的地线电流总是会选择阻抗Z(不是电阻R)最小的路径走,这条路径并不是终端到源端的直线路径(电阻R最小),而是走线在参考层上镜像路径(阻抗Z最小),也就是走线在其相邻参考平面上投影的路径。我们要做的就是保证这条路径连续,这样其构成的环路面积就是最小的,产生的电磁波辐射就是最小。

  信号的回路要做到真正的全部连续,不只是走线部分,还包括源端和终端,甚至要考虑到IC内部。

  高速信号的回流电流并不是完全分别在信号线的正下方,而是按一定的电流密度分布在其正下方及两侧,其正下方的电流密度最大,往两侧递减,如果信号太靠近板边,就会有部分回流电流通过空间辐射的形式返回源端,这样就造成电磁辐射。

  换层分几种情况:信号换层但参考面不变,参考面改变但其属性不变,参考面改变且其属性也改变。

  时钟信号,高速信号走线不得穿过高速、大功率等器件,以及不能穿过IO连接器和插槽下方;

  时钟信号力IO连接器侧板边300mil以上,在其他位置离板边200mil以上;

  变压器的初、次级信号走线不可重叠,蛇形绕线的走线也有此要求;RGB型号与其他信号线和岛边(电源岛,地岛)间距至少5W;

  IO电路从连接器往里看,要先进过防护器件,然后再是滤波电路,且都需要靠近连接器。

  高速信号在经过滤波器件和防护器件的时候,要按照信号流向依次通过,不能出现分支走线,如 ,RGB信号要从防护IC的

  上穿过,不能单独引分支线到防护IC上。时钟信号线可以在参考平面进行切换,但切换次数需要尽量可能控制在3次以内;

  高速信号和时钟信号不能出现没有端接的情况,特别是预留方案时,信号的两端都有预留有0欧姆电阻。

  信号走线间距如果太小,由于走线之间的分布电容影响,信号线之间的高频信号会相互串扰,影响信号质量,造成EMC问题。

  特别是IO信号,如果串扰到了高频的噪声,就很容易通过外设引线造成严重的辐射。

  信号线之间的分布电容与走线的间距,并行走线的长度,正对面积等因素有关,因此为了减少信号线之间的串扰,应该增大走线间距,减少并行走线的长度。相邻走线层要避免并行走线,因为其分布电容也很大,原则上要求垂直走线。

  串扰的程度除了与分布电容有关外,还和信号的频率、幅度有关,这就是为什么高频信号更容易发生串扰。

  对于高速信号来说,其走线路径都要求阻抗匹配,阻抗不匹配时会在阻抗不连续点产生反射,从而会影响信号质量,产生EMC问题。

  如果一组信号从源端-走线-终端这样一个路径上,源端阻抗=走线的特性阻抗=终端阻抗,这种理想情况下就不会发生反射。可以这样理解,阻抗变化越大,信号反射就越大,产生的EMC问题也就越严重,分支走线,终端空载等情况都是很严重的阻抗不匹配。

  功能模块之间(芯片之间),电源和地时共用的,模块工作时产生的噪声很容易通过这两个公共的路径相互

  ,造成严重的EMC问题。地往往会做到很大的面积,而且是单独的一层,这样相对来说比较干净(噪声非常小)。

  N脚都有一个0.1uF的电容,走线要加粗。对于BGA的芯片,则四个角上分布0.1uF,0.01uF的电容至少各一个。

  尽量靠近芯片放置。滤波电容尽可能直接打孔到地层,如果必须使用走线时,走线要保证短而粗。

  IO信号一般都需要接上外设使用,而外设一般都有比较长的连线,如果IO信号(包括电源和地)上带有高频噪声,就很容易通过 外设连线向空间产生较大的辐射,因此,IO信号都需要经过滤波。

  为了避免经过滤波后的信号在板内遭到二次污染,所以滤波电路要靠近端口放置。

  外界设备也容易引入外来的干扰,甚至是破坏性的干扰,因此,都需要使用防护器件,且要放在滤波电路前,防止破坏性干扰使滤波电路失效。

  设定规则:属于不同线路的铜(via trace shape pad)要保证一定的

  rgap距离,以耐受规定电压。同层:外层绝缘介质为空气,击穿电压强度为3KV/mm。内层绝缘介质为FR4。

  不同层:绝缘介质为FR4,击穿电场强度为15KV/mm。!!!注意考虑电场分布的非均匀性。

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